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该文件描述了金士顿的512M x 64位（4GB）DDR3-1333 CL7 SDRAM（同步DRAM）内存模块的特点特性，基于十六个256M x 8位FBGA组件。该模块经过测试，以1.65V的低延迟时间7-7-7-20以DDR3-1333运行。SPD编程为JEDEC标准延迟DDR3-1333时间9-9-9。该240针DIMM使用金接触指。JEDEC的电气和机械规格如下：