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该文件介绍了一种用于双数据速率同步DRAM应用的相位锁定环时钟驱动器。它具有扩频时钟兼容性、工作频率范围为60至140 MHz、低抖动等特点，可将一个差分时钟输入分配给十个差分输出。它还具有两线串行接口、高阻抗状态和低静态电流消耗等特性。