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MC10E/100E156是3-BIT 4:1 MUX-LATCH，包含3个4:1多路复用器，之后是带有差分输出的透明锁存器。当两条锁存使能(LEN1, LEN2)均为低电平时，锁存器是透明的，输出数据由多路复用器选择控制(SEL0, SEL1)控制。当LEN1或LEN2(或两者都)为逻辑高时，会锁存输出。主复位(MR)覆盖所有其他控制，将Q输出设置为低。