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这份文件介绍了高速六进制缓冲器，具有3态输出。它们可以作为单个6位或2位/4位组织，具有反相或非反相的数据路径。当使能（E）为低电平时，输出可以驱动15个TTL负载或60个低功耗肖特基负载。当输出使能（E）为高电平时，输出强制为高阻抗状态。如果将3态器件的输出连接在一起，则除了一个设备之外的所有设备必须处于高阻抗状态，以避免超过最大额定电流。设计人员应确保将输出使能信号设计好，以避免3态器件的输出重叠。