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更新: 30 September, 2023
ICS650-27是用于网络应用的低成本、低抖动、高性能时钟合成器。该设备采用模拟相位锁定环 (PLL) 技术，可接受 12.5 MHz 或 25 MHz 时钟或基频模式晶体输入，以生成用于网络芯片、PCI 设备、SDRAM 和 ASIC 的多个输出时钟。ICS650-27 的所有输出均具有零 ppm 合成误差。ICS650-27 与 ICS650-07 引脚兼容且功能等效，是一项性能升级，建议用于所有新的 3.3 V 设计。
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MD5: 9E6B1F7EE47330ECE4F721C141BA9B1A
发布时间: 04 June, 2012
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连接: ICS ICS650-27 Networking Clock Source PDF