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更新: 30 September, 2023
CDC2510是一款3.3V低漂移低抖动锁相环时钟驱动器,专为同步DRAM应用而设计。它使用一个PLL来精确地在频率和相位上对齐反馈(FBOUT)输出到时钟(CLK)输入信号。CDC2510工作于3.3V VCC,并提供集成的系列阻尼电阻,使其成为驱动点到点负载的理想选择。一个十个输出的阵列提供了十个低偏斜、低抖动的CLK副本。输出信号的占空比调整为50%,与CLK的占空比无关。所有输出都可以通过单个输出使能输入进行使能或禁用。当G输入为高时,输出在频率和相位上切换与CLK同步;当G输入为低时,输出被禁用到逻辑低状态。与许多包含PLL的产品不同,CDC2510不需要外部RC网络。PLL的环路滤波器包含在芯片中,最小化了功耗和成本。
文件格式: PDF
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MD5: 251D1C1D3DC09952E957E4E90F3A861F
发布时间: 09 May, 2012
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连接: TEXAS INSTRUMENTS CDC2510 DATA SHEET PDF